相关电路图：
如图所示为由LF198与LM122H构成的乘积检波器的部分电路。同步时钟输入到两个LM122H组成的级联定时器电路，将同步时钟转换为所需宽度的脉冲(图中为10μs)，加到LF198的“LOGIC”端(8脚)作为采样保持控制信号。信号输入LF198的3脚。输入信号包含大量幅度高于有用信号的噪声成分，经过检波器后，输出信号巾的噪声被滤除，输出的是纯净的信号。R3的取值应使6脚电压为0～3V。
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标签： 采样保持放大电路 电路图
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